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Die HDI-PCB-Technologie ermöglicht eine höhere Schaltkreisdichte durch Mikrovias, feine Linien und sequentielle Laminierung und ermöglicht so mehr Funktionalität in kleineren Formfaktoren. Im Gegensatz zu herkömmlichen Leiterplatten, die auf Durchgangslöchern basieren, verwendet HDI blinde, vergrabene und gestapelte Mikrovias, um Signale zwischen Schichten zu leiten, ohne Oberfläche zu beanspruchen. Dies ist für moderne Elektronikgeräte wie Smartphones, medizinische Implantate und Luft- und Raumfahrtsysteme von entscheidender Bedeutung, bei denen Platz und Leistung von entscheidender Bedeutung sind.
Die Herstellung von HDI PCBs erfordert eine präzise Prozesskontrolle, insbesondere für lasergebohrte Mikrovias, Kupferfüllung und Laminierungsausrichtung. Designer müssen Via-in-Pad-Regeln, Stapelsymmetrie und DFM-Einschränkungen frühzeitig berücksichtigen, um Ertragsprobleme zu vermeiden. Für Omini RFQs sollten Herstellbarkeitsprüfungen vor der Freigabe die Überprüfung, Fertigung, Montage, Inspektion und den Testumfang miteinander verbinden.
HDI PCB-Grundlagen: Struktur und Vorteile
Im Kern erreicht eine HDI-Leiterplatte eine hohe Dichte durch die Minimierung der Strukturgrößen und die Verwendung von Mikrovias für Zwischenschichtverbindungen. Standard-Leiterplatten verwenden typischerweise mechanisches Bohren für Durchkontaktierungen ≥150 µm, während HDI Laserbohren für Durchkontaktierungen mit einem Durchmesser von nur 50 µm verwendet. Diese Mikrovias können blind (die äußere mit der inneren Schicht verbindend), vergraben (nur die innere Schicht) oder gestapelt (vertikal über mehrere Schichten ausgerichtet) sein.
Der Hauptvorteil besteht in der Vergrößerung der Routing-Kanäle pro Flächeneinheit. Beispielsweise kann eine 4-lagige HDI-Platine mit Mikrovias aufgrund der effizienten Raumnutzung unter den Komponenten mehr Signale weiterleiten als eine herkömmliche 8-lagige Platine. Dies ermöglicht es Designern, entweder die Platinengröße zu reduzieren oder Funktionen hinzuzufügen, ohne den Platzbedarf zu vergrößern. Zu den gängigen Anwendungen gehören BGAs mit Fine-Pitch-Gehäusen, HF-Module und Hochgeschwindigkeitssteckverbinder, bei denen Signalintegrität und Miniaturisierung von größter Bedeutung sind.
HDI verbessert auch die elektrische Leistung. Kürzere Verbindungswege reduzieren Induktivität und Kapazität, was für digitale und analoge Hochgeschwindigkeitsschaltungen von Vorteil ist. Die Verwendung von gestapelten Microvias kann herkömmliche vergrabene Vias ersetzen, was die Herstellung vereinfacht und gleichzeitig die Signalintegrität beibehält.
Designregeln und Via-in-Pad-Implementierung
Via-in-Pad ist ein Markenzeichen des HDI-Designs, insbesondere für BGAs und QFNs, bei denen die Fluchtwegführung eine Herausforderung darstellt. Die Platzierung der Durchkontaktierung direkt unter dem Komponentenpad spart wertvolle Fläche, erfordert aber spezielle Herstellungsschritte: Die Durchkontaktierung muss gebohrt, plattiert, mit leitendem oder nicht leitendem Epoxidharz gefüllt und anschließend plattiert werden, um eine flache, lötbare Oberfläche zu schaffen.
Zu den wichtigsten Designregeln gehören:
- Mindestdurchkontaktierungsdurchmesser (oft 50–75 µm für Laserbohren)
- Maximales Seitenverhältnis (Tiefe:Durchmesser) von 1:1 für zuverlässiges Plattieren und Füllen
- Pad-Größe ausreichend, um die Durchkontaktierung plus Ring aufzunehmen (typischerweise ≥150 µm Gesamtpad-Durchmesser)
- Lötmaskenabstand zwischen Pad-Kante und Durchgangsloch, um ein Einklemmen der Maske zu verhindern
Das Füllen der Durchkontaktierung ist von entscheidender Bedeutung, da ungefüllte Durchkontaktierungen beim Reflow-Löten Lot einfangen können, was zu Hohlräumen oder unzureichendem Verbindungsvolumen führt. Leitfähige Füllung verbessert die thermische und elektrische Leitfähigkeit, erhöht jedoch die Kosten; Eine nichtleitende Füllung ist bei Signaldurchkontaktierungen üblich. Die DFM-Überprüfung sollte bestätigen, ob die Via-in-Pad-Struktur herstellbar und mit den Zuverlässigkeitsanforderungen der Lötverbindung kompatibel ist.
Stackup-Design und Signalintegrität
HDI-Stackups verwenden häufig eine sequentielle Laminierung, bei der dünne dielektrische Schichten und Kupferfolien in Zyklen hinzugefügt werden, um Mikrovia-Schichten aufzubauen. Ein symmetrischer Aufbau (gleiche Schichtanzahl und Dicke über/unter der Mitte) verhindert ein Verziehen während der Laminierung und Montage. Asymmetrie führt zu Biegung und Verdrehung, was zu einer falschen Platzierung von Bauteilen oder Lötfehlern führen kann.
Eine kontrollierte Impedanz ist ein weiterer kritischer Faktor. Bei Hochgeschwindigkeitssignalen (z. B. DDR, PCIe, USB 3.0+) müssen Leiterbahnbreite, Abstand und dielektrische Dicke streng kontrolliert werden, um eine Impedanz von 50 Ω oder eine Differenzimpedanz von 100 Ω aufrechtzuerhalten. Die dünnen Dielektrika von HDI ermöglichen eine Impedanzkontrolle bei schmaleren Leiterbahnen, aber Schwankungen im Harzgehalt oder beim Laminierungsdruck können die Impedanzziele verschieben.
Designer sollten Feldlöser verwenden, um die Impedanz zu überprüfen, und mit Herstellern zusammenarbeiten, die Stapelempfehlungen auf der Grundlage tatsächlicher Materialeigenschaften geben können. Die Annahmen zur Prepreg-Auswahl und Laminierung sollten Impedanzziele unterstützen und gleichzeitig herstellbar bleiben.
Überlegungen zu DFM, Ertrag und Herstellung
HDI DFM konzentriert sich auf Funktionen, die sich auf die Fertigungsausbeute auswirken: Mikrovia-Aspektverhältnis, Pad-Größe, Kupferdicke und Breite des Lötstopplackdamms. Zu den häufigsten Fehlerarten gehören Mikrovia-Öffnungen (unvollständige Beschichtung), Kurzschlüsse (übermäßige Beschichtung oder Rückstände) und Delaminierung (aufgrund von Feuchtigkeit oder thermischer Belastung).
Während der Gerber-Überprüfung sollte die DFM-Checkliste Folgendes enthalten:
- Laserbohrdateien für korrekte Durchgangsgrößen und -positionen
- Kupferabstand zur Vermeidung von Ätzproblemen in engen Räumen
- Breite der Lötmaske zwischen den Pads (mindestens 2–3 mil, um Brückenbildung zu verhindern)
- Kupferausgleich über die Schichten hinweg, um Verzug zu reduzieren
In der Produktion kann der Inspektionsplan eine Röntgeninspektion zur Durchkontaktierungs- und Hohlraumerkennung, AOI für die Qualität der Lötverbindung nach SMT und Zuverlässigkeitstests umfassen, wenn dies vom Kunden gefordert wird. Für eine hohe Zuverlässigkeit HDI sollten Coupon-Tests auf Mikrovia-Stärke und Lötstellenermüdung vor der Veröffentlichung besprochen werden.
Die Vorlaufzeit für HDI-Prototypen ist aufgrund der aufeinanderfolgenden Laminierungsschritte in der Regel länger als bei Standard-PCBs. Die Panelisierungsstrategie sollte Ertrag, Registrierung, Handhabung und die engeren Toleranzen von HDI berücksichtigen.
Erweiterte Konzepte: Stacked Vias, ELIC und AnyLayer HDI
Über den einfachen HDI hinaus steigern fortschrittliche Techniken die Dichte weiter. Gestapelte Microvias (vertikal ausgerichtete Vias über mehr als zwei Schichten) ersetzen herkömmliche vergrabene Vias und reduzieren so die Prozessschritte. Every Layer Interconnect (ELIC) ermöglicht Microvias in allen Schichten und ermöglicht so ein extrem dichtes Routing für Substrate wie Smartphone-Motherboards.
AnyLayer HDI geht noch einen Schritt weiter – jede Schicht kann über Microvias mit jeder anderen verbunden werden, sodass in einigen Designs keine dedizierten Strom-/Masseebenen erforderlich sind. Dies erhöht die Routing-Flexibilität, erfordert jedoch eine präzise Ausrichtung von Schicht zu Schicht und eine strenge Prozesskontrolle.
Diese erweiterten HDI-Formulare sind in der modernen Unterhaltungselektronik und im Hochleistungsrechnen weit verbreitet. Allerdings erhöhen sie die Kosten und die Komplexität, weshalb eine frühzeitige Einbindung unerlässlich ist. Bei der technischen Überprüfung sollte bewertet werden, ob Standard HDI, ELIC oder AnyLayer basierend auf Leistungsanforderungen, Volumen und Budget gerechtfertigt ist.
Praktische Anleitung für Ingenieure und Käufer
Geben Sie bei der Spezifikation von HDI-Leiterplatten in Ihren Fertigungshinweisen klare Aufbauzeichnungen, Impedanzanforderungen und Details zu Via-in-Pads an. Fügen Sie bei Bedarf Testcoupons für die Microvia-Zuverlässigkeit bei. Vermeiden Sie Überspezifikationen – die Verwendung von ELIC, wenn Standard-HDI ausreicht, verursacht unnötige Kosten und Vorlaufzeit.
Führen Sie während des Prototypings eine kleine Charge aus, um das DFM-Feedback vor der Skalierung zu validieren. Verwenden Sie die Erstmusterprüfung, um die Qualität der Lötverbindungen auf den Via-in-Pads BGAs zu überprüfen und auf Tombstoning oder Lotkugeln zu prüfen. Besprechen Sie bei der Produktion größerer Stückzahlen die Panelisierung, die Platzierung der Passermarken und das Design der Lotpastenschablone, um das Risiko zu reduzieren.
Behandeln Sie HDI schließlich nicht nur als Schritt bei der Platinenherstellung, sondern als Teil des umfassenderen PCBA-Workflows. Die frühzeitige Einbindung Ihres EMS-Partners in die Designprüfung verhindert kostspielige Neukonstruktionen und stellt sicher, dass die Platine für Montage, Tests und langfristige Zuverlässigkeit im Feld optimiert ist.
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